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堅持小班授課，為保證培訓(xùn)效果，增加互動環(huán)節(jié)，每期人數(shù)限3到5人。

上課時間和地點

上課地點：【上海】：同濟大學(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院【北京分部】：北京中山學(xué)院/福鑫大樓【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路）【成都分部】：領(lǐng)館區(qū)1號（中和大道）【沈陽分部】：沈陽理工大學(xué)/六宅臻品【鄭州分部】：鄭州大學(xué)/錦華大廈【石家莊分部】：河北科技大學(xué)/瑞景大廈【廣州分部】：廣糧大廈【西安分部】：協(xié)同大廈
最近開課時間(周末班/連續(xù)班/晚班）：2025年7月14日..用心服務(wù)..........--即將開課--......................

實驗設(shè)備

　    ☆資深工程師授課

        ☆注重質(zhì)量 ☆邊講邊練
        ☆合格學(xué)員免費推薦工作
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質(zhì)量保障

        1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費在以后培訓(xùn)班中重聽；
        2、課程完成后,授課老師留給學(xué)員手機和Email,保障培訓(xùn)效果,免費提供半年的技術(shù)支持。
        3、培訓(xùn)合格學(xué)員可享受免費推薦就業(yè)機會。

課程大綱

Xilinx 部分重配置工具和技術(shù)培訓(xùn)
? Xilinx 部分重配置工具和技術(shù)培訓(xùn)
課程對象
具有 HDL（VHDL 或 Verilog）和 Xilinx 設(shè)計方法相關(guān)工作經(jīng)驗、需要使用部分重配置技術(shù)的數(shù)字設(shè)計者
課程概要
1
課程介紹
部分重配置方法
實驗1：部分重配置流程
部分重配置設(shè)計建議
部分重配置工具流程
（可選）FPGA 配置簡介
部分重配置比特流
實驗2：構(gòu)建 HDL ICAP 控制器
2
管理時鐘資源
管理時序
實驗3：部分重配置時序分析和約束
嵌入式環(huán)境（EDK）
實驗4：EDK 部分重配置
部分重配置調(diào)試
實驗 5：?ChipScope Pro 工具部分重配置監(jiān)控
PCIe 內(nèi)核與部分重配置
(可選)?實驗 6:?構(gòu)建一個快速配置 PCIe 系統(tǒng)
課程總結(jié)
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